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Parts
- P1 · 1.1 常用的数制
- P2 · 1.2 数制的转换
- P3 · 1.3 常用的BCD码
- P4 · 2.1 逻辑运算
- P5 · 2.2 逻辑函数及其表示方法
- P6 · 2.3 逻辑代数的运算法则
- P7 · 2.4 逻辑函数的表示形式
- P8 · 2.5 逻辑函数代数法化简
- P9 · 2.6 逻辑函数卡诺图化简
- P10 · 2.7 含有无关项的逻辑函数化简
- P11 · 3.1 集成逻辑门
- P12 · 3.2 半导体二极管门电路
- P13 · 3.3 三极管的开关特性
- P14 · 3.4 TTL集成逻辑门电路
- P15 · 3.5 TTL与非门的电气特征
- P16 · 3.6 TTL与非门的负载能力
- P17 · 3.7 TTL集成开路门三态门
- P18 · 3.8 TTL集成门电路使用常识
- P19 · 3.9 NMOS集成逻辑门电路
- P20 · 3.10 CMOS集成逻辑门电路
- P21 · 4.1 组合逻辑电路的分析
- P22 · 4.2 组合逻辑电路的设计
- P23 · 4.3 加法器的原理
- P24 · 4.4 集成加法器应用
- P25 · 4.5 编码器的原理
- P26 · 4.6 优先编码器
- P27 · 4.7 译码器
- P28 · 4.8 显示译码器
- P29 · 4.9 二进制译码器的应用
- P30 · 4.10 数据选择器的原理
- P31 · 4.11 数据选择器的典型应用
- P32 · 4.12 数值比较器
- P33 · 4.13 组合逻辑电路的竞争与冒险
- P34 · 5.1 时序电路概述
- P35 · 5.2 RS锁存器
- P36 · 5.3 触发器
- P37 · 5.4 同步时序逻辑电路的分析
- P38 · 5.5 异步时序逻辑电路的分析
- P39 · 5.6 同步时序逻辑电路的设计
- P40 · 5.7 寄存器
- P41 · 5.8 计数器
- P42 · 5.9 集成计数器
- P43 · 6.1 EDA概述
- P44 · 6.2 EDA设计流程
- P45 · 6.3 面向CPLDFPGA开发的EDA软件
- P46 · 6.4 HDL简介
- P47 · 6.5 Verilog HDL基础
- P48 · 6.6 不同抽象级别的Verilog HDL模型
- P49 · 7.1 半导体存储器概述
- P50 · 7.2 只读存储器(ROM)
- P51 · 7.3 随机存取存储器(RAM)
- P52 · 7.4 存储容量的扩展
- P53 · 8.1 脉冲电路概述
- P54 · 8.2 集成555定时器
- P55 · 8.3 施密特触发器
- P56 · 8.4 单稳态触发器
- P57 · 8.5 多谐振荡器
- P58 · 9.1 数据采集系统概述
- P59 · 9.2 DA转换器简介
- P60 · 9.3 倒T型电阻网络DAC
- P61 · 9.4 AD转换器的基本原理
- P62 · 9.5 逐次逼近型ADC
- P63 · 10.1 可编程逻辑器件概述
- P64 · 10.2 可编程逻辑器件分类
- P65 · 10.3 组合逻辑电路的PLD实现
Description
参考教材: 数字电子技术基础 于云华 中国石油大学出版社 2011-05